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高速VITERBI譯碼器的研究與設計
全部作者： 李選中 李慶 何文浩 第1作者單位： 武漢理工大學信息工程學院 論文摘要： 設計了1個高速(2,1,6)Viterbi譯碼器，通過采用并行基-4結構和比特級進位保存算法（Carry-Save Arithmetic），改進了Viterbi算法中加-比-選單元(Add-Compare-Select Unit)的結構，消除傳統行波進位加法(Ripple-Carry Adder)結構中的進位鏈，縮減了Viterbi譯碼器的關鍵路徑，極大的降低了譯碼時延，從而提高譯碼速度，譯碼速度可達到200Mb/s，可用在高速數字通信的不同應用場合中。 關鍵詞： Viterbi譯碼器；進位保存算法；加-比-選；高速 (瀏覽全文) 發表日期： 2008年03月20日 同行評議：
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